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<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="3.9.0" version="1.0">
This file is intended to be loaded by Logisim-evolution v3.9.0(https://github.com/logisim-evolution/).
<lib desc="#Wiring" name="0">
<tool name="Pin">
<a name="appearance" val="classic"/>
</tool>
</lib>
<lib desc="#Gates" name="1"/>
<lib desc="#Plexers" name="2"/>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4"/>
<lib desc="#I/O" name="5"/>
<lib desc="#HDL-IP" name="6">
<tool name="VHDL Entity">
<a name="content">--------------------------------------------------------------------------------
-- HEIG-VD, institute REDS, 1400 Yverdon-les-Bains
-- Project :
-- File :
-- Autor :
-- Date :
--
--------------------------------------------------------------------------------
-- Description :
--
--------------------------------------------------------------------------------
library ieee;
use ieee.std_logic_1164.all;
--use ieee.numeric_std.all;
entity VHDL_Component is
port(
------------------------------------------------------------------------------
--Insert input ports below
horloge_i : in std_logic; -- input bit example
val_i : in std_logic_vector(3 downto 0); -- input vector example
------------------------------------------------------------------------------
--Insert output ports below
max_o : out std_logic; -- output bit example
cpt_o : out std_logic_Vector(3 downto 0) -- output vector example
);
end VHDL_Component;
--------------------------------------------------------------------------------
--Complete your VHDL description below
architecture type_architecture of VHDL_Component is
begin
end type_architecture;
</a>
</tool>
</lib>
<lib desc="#TCL" name="7"/>
<lib desc="#Base" name="8">
<tool name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
</tool>
</lib>
<lib desc="#BFH-Praktika" name="9"/>
<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="8" map="Button2" name="Menu Tool"/>
<tool lib="8" map="Button3" name="Menu Tool"/>
<tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="8" name="Poke Tool"/>
<tool lib="8" name="Edit Tool"/>
<tool lib="8" name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
</tool>
<sep/>
<tool lib="0" name="Pin"/>
<tool lib="0" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
</tool>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
</toolbar>
<circuit name="main">
<a name="appearance" val="logisim_evolution"/>
<a name="circuit" val="main"/>
<a name="downloadFrequency" val="1.0"/>
<a name="simulationFrequency" val="2.0"/>
<comp lib="0" loc="(1110,1150)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Clck"/>
</comp>
<comp lib="0" loc="(1190,290)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Nibble1"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(1190,320)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Nibble2"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(1200,1620)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Nibble7"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(1200,620)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Clck"/>
</comp>
<comp lib="0" loc="(1200,650)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegOutput1"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1210,1620)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="none"/>
<a name="bit3" val="none"/>
<a name="fanout" val="1"/>
<a name="incoming" val="4"/>
</comp>
<comp lib="0" loc="(1220,1400)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="LineNumber"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1220,1490)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="LineNumber"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1220,1560)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegOutput2"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1220,1590)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegOutput1"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1230,1380)" name="Constant"/>
<comp lib="0" loc="(1230,1470)" name="Constant"/>
<comp lib="0" loc="(1230,1780)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Clck"/>
</comp>
<comp lib="0" loc="(1230,300)" name="Splitter">
<a name="bit0" val="1"/>
<a name="bit2" val="1"/>
<a name="bit3" val="1"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
<a name="bit6" val="0"/>
<a name="bit7" val="0"/>
<a name="facing" val="west"/>
<a name="incoming" val="8"/>
</comp>
<comp lib="0" loc="(1250,1760)" name="Constant"/>
<comp lib="0" loc="(1280,1810)" name="Pin">
<a name="appearance" val="classic"/>
<a name="facing" val="north"/>
</comp>
<comp lib="0" loc="(1330,1740)" name="Tunnel">
<a name="label" val="LineNumber"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1360,1100)" name="Splitter">
<a name="appear" val="right"/>
<a name="bit1" val="0"/>
<a name="bit10" val="2"/>
<a name="bit11" val="2"/>
<a name="bit12" val="3"/>
<a name="bit13" val="3"/>
<a name="bit14" val="3"/>
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<comp loc="(730,1620)" name="FourBitEquals"/>
<comp loc="(730,1680)" name="FourBitEquals"/>
<comp loc="(730,1740)" name="FourBitEquals"/>
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<comp loc="(730,1860)" name="FourBitEquals"/>
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